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PIC16F785/HV785
DS41249E-page 10
2008 Microchip Technology Inc.
FIGURE 2-2:
DATA MEMORY MAP OF THE PIC16F785/HV785
Indirect addr.(1) 00h
Indirect addr.(1) 80h
Indirect addr.(1) 100h
Indirect addr.(1) 180h
TMR0
01h
OPTION_REG
81h
TMR0
101h
OPTION_REG
181h
PCL
02h
PCL
82h
PCL
102h
PCL
182h
STATUS
03h
STATUS
83h
STATUS
103h
STATUS
183h
FSR
04h
FSR
84h
FSR
104h
FSR
184h
PORTA
05h
TRISA
85h
PORTA
105h
TRISA
185h
PORTB
06h
TRISB
86h
PORTB
106h
TRISB
186h
PORTC
07h
TRISC
87h
PORTC
107h
TRISC
187h
08h
88h
108h
188h
09h
89h
109h
189h
PCLATH
0Ah
PCLATH
8Ah
PCLATH
10Ah
PCLATH
18Ah
INTCON
0Bh
INTCON
8Bh
INTCON
10Bh
INTCON
18Bh
PIR1
0Ch
PIE1
8Ch
10Ch
PIE1
18Ch
0Dh
8Dh
10Dh
18Dh
TMR1L
0Eh
PCON
8Eh
10Eh
18Eh
TMR1H
0Fh
OSCCON
8Fh
10Fh
18Fh
T1CON
10h
OSCTUNE
90h
PWMCON1
110h
190h
TMR2
11h
ANSEL0
91h
PWMCON0
111h
191h
T2CON
12h
PR2
92h
PWMCLK
112h
192h
CCPR1L
13h
ANSEL1
93h
PWMPH1
113h
193h
CCPR1H
14h
94h
PWMPH2
114h
194h
CCP1CON
15h
WPUA
95h
115h
195h
16h
IOCA
96h
116h
196h
17h
97h
117h
197h
WDTCON
18h
REFCON
98h
118h
198h
19h
VRCON
99h
CM1CON0
119h
199h
1Ah
EEDAT
9Ah
CM2CON0
11Ah
19Ah
1Bh
EEADR
9Bh
CM2CON1
11Bh
19Bh
1Ch
EECON1
9Ch
OPA1CON
11Ch
19Ch
1Dh
EECON2(1)
9Dh
OPA2CON
11Dh
19Dh
ADRESH
1Eh
ADRESL
9Eh
11Eh
19Eh
ADCON0
1Fh
ADCON1
9Fh
11Fh
19Fh
General
Purpose
Register
96 Bytes
20h
General
Purpose
Register
32 Bytes
A0h
BFh
120h
1A0h
6Fh
C0h
EFh
16Fh
1EFh
70h
accesses
Bank 0
F0h
accesses
Bank 0
170h
accesses
Bank 0
1F0h
7Fh
FFh
17Fh
1FFh
Bank 0Bank 1Bank 2Bank 3
Unimplemented data memory locations, read as ‘0’.
Note 1: Not a physical register.
File
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